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認(rèn)證信息
認(rèn)證類型:個(gè)人認(rèn)證
認(rèn)證主體:常**(實(shí)名認(rèn)證)
IP屬地:河北
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1、現(xiàn)代戰(zhàn)場(chǎng)的作戰(zhàn)要求需要雷達(dá)不僅能“看得見”,而且要“看的清”,這就要求雷達(dá)不僅作用距離遠(yuǎn)、測(cè)量精度高,而且分辨率要高乃至能成像。寬帶線性調(diào)頻是一種適用于高分辨或成像雷達(dá)的信號(hào)形式。 本文對(duì)雷達(dá)性能與雷達(dá)信號(hào)之間的聯(lián)系作了介紹,分析寬帶線性調(diào)頻信號(hào)的優(yōu)勢(shì)。介紹了多種寬帶線性調(diào)頻信號(hào)的產(chǎn)生方式,并對(duì)各種實(shí)現(xiàn)方法作出評(píng)估比較,運(yùn)用FPGA+高速DAC以DDS技術(shù)實(shí)現(xiàn)寬帶線性調(diào)頻信號(hào)。本文的研究重點(diǎn)是低速的FPGA與高速DAC數(shù)據(jù)匹配
2、技術(shù)以及高速DAC的使用。首先通過計(jì)算仿真多路DDS信號(hào)合成單路DDS信號(hào),驗(yàn)證設(shè)計(jì)的正確性,然后按照設(shè)計(jì)方案設(shè)計(jì)了硬件電路并開發(fā)了系統(tǒng)軟件。選用的高速雙端口DAC器件和高速DDR數(shù)據(jù)傳輸可以使得FPGA數(shù)據(jù)端口運(yùn)行速度降為DAC時(shí)鐘的1/4,在FPGA內(nèi)部采用多路并行DDS信號(hào)合成,使得FPGA內(nèi)數(shù)據(jù)率大大的降低。采用AD9739特有的MIXMODE可以直接獲得第二、第三奈奎斯特區(qū)域的射頻線性調(diào)頻信號(hào),并對(duì)產(chǎn)生的信號(hào)進(jìn)行了測(cè)試。測(cè)試結(jié)
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