DAB接收機AAC解碼器設計和FPGA驗證.pdf_第1頁
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文檔簡介

1、隨著模擬時代向數字時代的推進和數字技術的多年實際應用，數字音頻廣播(DAB-Digital Audio Broadcasting)技術已相當成熟，并贏得了廣大用戶的青睞。出于進一步提高數據壓縮率的目的，國際DAB組織在2007年將壓縮比高的MPEG-4 HE-AAC v2引入了DAB標準，稱為DAB+，使其在保持CD音質的情況下更有效地利用頻譜資源。
　　 本課題針對目前DAB接收機中DSP軟件AAC(Advanced Audi

2、o Coding，先進音頻編碼)解碼器功耗大的問題，提出了低功耗AAC解碼器的ASIC設計，實現了AAC解碼器的純硬件設計，大量的FPGA測試驗證表明，該設計可實現DAB+節(jié)目解碼，且解碼后的聲音流暢，音質令人滿意。將低功耗AAC解碼器的設計加入DAB基帶解碼芯片后，以較低的硬件代價實現了DAB+和DAB兩種不同標準的兼容，為雙制式、低功耗、低成本的便攜式DAB接收機的設計奠定了基礎。
　　 本文首先介紹了AAC的分類與特點，分

3、析了DAB+標準對AAC的限制，隨后介紹了AAC的一般解碼流程和各個模塊的功能與實現，提出了適用于DAB4+的AAC解碼器流程及硬件實現框圖。其次，基于低功耗的設計目標，對反量化和IMDCT算法進行了優(yōu)化，并設計專用的DSP模塊，減小了硬件設計的難度與運算量。然后，提出了AAC解碼器的單獨驗證方案，實際驗證了設計的正確性。在此基礎上，將低功耗AAC解碼器的設計加入DAB基帶解碼芯片，與MPEG AudioLayerⅡ解碼器實現資源共享，

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