基于ASIC的頻率合成器數字部分研究與實現.pdf

1、隨著現代通信、雷達、電子偵察和對抗技術的飛速的發(fā)展，對作為核心部件的頻率合成器的性能指標提出了越來越高的要求，寬頻帶、高頻率分辨、低捷變時間、高頻率穩(wěn)定度、低相位噪聲、低雜散、能程控等。這些技術要求用普通的模擬電路技術是很難達到的。因此，如何設計一種新的頻率合成器來產生大量高精度、高穩(wěn)定度的頻率信號成為了合成技術的關鍵。 本文首先介紹了頻率合成的基本理論，對各種頻率合成技術進行了比較和分析，得出了其優(yōu)缺點，并且著重介紹了頻率合成

2、中經常用到的鎖相環(huán)和DDS技術：由于所要設計的頻率合成器是基于ASIC技術的，因此本文中還介紹了一下ASIC設計流程和相關技術；然后對頻率合成器進行了模塊劃分和算法分析，包括模擬部分；最后，完成模塊中所有數字部分的設計，仿真到綜合優(yōu)化的全過程，所采用的語言為Verilog HDL，仿真工具為Mentor公司的ModelSim，綜合工具為Synopsys公司的Design Compiler，調用的元器件庫為中芯國際的.18μm庫，為滿足高